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Nemecký jazyk
VHDL-Synthese
Autor: Jürgen Reichardt
Die erweiterte 8. Auflage dieses Standardwerks ergänzt die bisherige Darstellung der VHDL-Simulation des Buches durch konkrete Benutzeranleitungen für den VHDL-Simulator ModelSim. Auch wird die Verwendung des Simulations- und Synthesewerkzeugs Vivado... Viac o knihe
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Die erweiterte 8. Auflage dieses Standardwerks ergänzt die bisherige Darstellung der VHDL-Simulation des Buches durch konkrete Benutzeranleitungen für den VHDL-Simulator ModelSim. Auch wird die Verwendung des Simulations- und Synthesewerkzeugs Vivado vorgestellt, erfordelich um VHDL-Code in neueren FPGAs der Fa. Xilinx zu implementieren. Mit ausgewählten Beispielen werden Implementierungen für Artix-FPGAs vorgestellt und diskutiert.
- Vydavateľstvo: de Gruyter Oldenbourg
- Rok vydania: 2020
- Formát: Paperback
- Rozmer: 240 x 170 mm
- Jazyk: Nemecký jazyk
- ISBN: 9783110673456
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